AD9528 時脈產生器

Analog Devices 的低抖動時脈在高速轉換器內支援 JESD204B

Analog Devices 的 AD9528 時脈產生器影像 Analog Devices 的 AD9528 是二級 PLL,含整合式 JESD204B SYSREF 產生器,達到多重元件同步。 第一級鎖相迴路 (PLL) (PLL1) 透過降低現有系統時脈的抖動,提供輸入參考調節。 第二級 PLL (PLL2) 提供高頻率時脈,達到低整合式抖動,以及時脈輸出驅動器的低寬頻雜訊。 外接 VCXO 提供 PLL2 所需的低雜訊參考,達到可接受效能要求的限制相位雜訊和抖動。 晶片上 VCO 在 3.450 GHz 至 4.025 GHz 之間微調。 整合式 SYSREF 產生器輸出單次、N 次,或連續訊號,與 PLL1 和 PLL2 輸出同步至時間排列多重裝置。

AD9528 產生最大頻率為 1.25 GHz 的兩個輸出(輸出 1 和輸出 2),以及 12 個高達 1 GHz 的輸出。 各個輸出可配置為直接從 PLL1、PLL2 或內建 SYSREF 產生器輸出。 14 個輸出通道皆個別含有一個分頻器,具有粗略數位相位調整,以及一個類比精細相位延遲模塊,能在所有 14 個輸出中達到完整的計時對位彈性。 AD9528 亦可用作雙輸入彈性緩衝器,分配 14 個元件時脈和/或 SYSREF 訊號。 電源啟動時,AD9528 將 VCXO 訊號直接傳送到輸出 12 和輸出 13,作為啟動就緒時脈。

特點
  • 14 個可設定輸出,適合 HSTL 或 LVDS
  • 最大輸出頻率
    • 2 個輸出高達 1.25 GHz
    • 12 個輸出高達 1 GHz
  • 依賴電壓控制晶體振盪器 (VCXO) 頻率準確度(啟動頻率準確度:小於 ±100 ppm)
  • 每個輸出專屬 8 位元分頻器
    • 粗略延遲:在 RF VCO 分頻器輸出頻率的 1/2 週期為 63 步階 ,無抖動衝擊
    • 精細延遲:31 ps 解析度為 15 步階
  • 典型的輸出對輸出偏斜:20 ps
  • 奇數分頻器設定的工作週期修正
  • 電源啟動時的輸出 12 和輸出 13、VCXO 輸出
  • 絕對輸出抖動:122.88 MHz 時小於 160 fs、12 kHz 至 20 mHz 整合範圍
應用
  • 高效能無線接收器
  • LTE 和多載波 GSM 基地台
  • 無線和寬頻基礎架構
  • 醫療儀器
  • 能對高速 ADC、DAC、DDS、DDC、DUC、MxFE 進行時脈設定;支援 JESD204B
  • 低抖動、低相位雜訊時脈分配
  • ATE 和高效能儀器

Development Boards

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EVAL BOARD FOR AD9528AD9528/PCBZEVAL BOARD FOR AD95280 - 即時供貨See Page for Pricing查看詳情

AD9528 Clock Generators

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發佈日期: 2015-03-18